高速數(shù)字電路開發(fā)工程師
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北京碩士研究生 3-5年 2人 2025-05-27發(fā)布查看公告詳情

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職位詳情

基本信息

職位名稱：高速數(shù)字電路開發(fā)工程師

職位類型：技術(shù)支撐崗

工作地點：北京

招聘人數(shù)： 2

報名方式：電子郵件

截止時間：2025-05-29

用人部門：電子信息工程學(xué)院

職位編制：事業(yè)編制

其他要求

學(xué)歷要求：碩士研究生

工作經(jīng)驗：3-5年

需求專業(yè)：

電子科學(xué)與技術(shù), 信息與通信工程

該需求專業(yè)僅展示一級學(xué)科

崗位職責(zé)

1.負(fù)責(zé)高速數(shù)字電路設(shè)計與調(diào)試，
2.負(fù)責(zé)高速采集、高速信號處理、高速背板互聯(lián)等相關(guān)硬件方案的可行性分析和實施，
3.完成相關(guān)技術(shù)文檔（方案設(shè)計報告，測試大綱，測試報告等）及設(shè)計資料（原理圖、PCB板、BOM表等）編寫與評審，
4.對數(shù)字器件選型和供應(yīng)商進(jìn)行評估。

任職要求

1.具有3年以上高速數(shù)字電路設(shè)計經(jīng)驗，碩士以上學(xué)歷；
2.具有數(shù)字邏輯、模擬電子線路、通信、軟件無線電等理論知識;
3.熟練使用高速數(shù)字電路設(shè)計仿真驗證相關(guān)EDA軟件工具；
4.熟悉示波器、頻譜儀、萬用表、信號源、邏輯分析儀等設(shè)備的使用；
5.具有PCI/CPCI/PCIe、LAN、USB等高速接口電路設(shè)計經(jīng)驗者優(yōu)先；
6.具有FPGA高速IO接口項目經(jīng)驗者優(yōu)先；
7.具有FPGA進(jìn)行數(shù)字信號處理項目經(jīng)驗者優(yōu)先；
8.具有良好的溝通能力和團隊合作精神。

其他說明

1.應(yīng)聘者通過電子郵件將個人簡歷（PDF形式）發(fā)送至郵箱，簡歷中應(yīng)包括主要個人信息、教育經(jīng)歷、工作經(jīng)歷、期望待遇、個人近照等，發(fā)送郵件和附件均以“崗位名稱+姓名”命名，報名截止時間為2025年5月29日；

競爭力分析

解鎖詳細(xì)分析

您與該職位匹配度: ***，已超過了 *** 的競爭者，建議************

較低

一般

比較匹配

非常匹配

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